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author: volvet <[email protected]>
date: Mon Apr 28 14:33:32 EDT 2014
Merge pull request #759 from mstorsjo/deblock-neon-transpose Do full register loads instead of single-lane loads in DeblockLumaEq4H_neon
--- a/codec/common/arm/deblocking_neon.S
+++ b/codec/common/arm/deblocking_neon.S
@@ -140,11 +140,6 @@
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-.macro LOAD_LUMA_DATA_4
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-
.macro STORE_LUMA_DATA_3
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vst4.u8 {\arg0[\arg5],\arg1[\arg5],\arg2[\arg5],\arg3[\arg5]}, [r2], r1.endm
-.macro LOAD_LUMA_DATA_4 arg0, arg1, arg2, arg3, arg4, arg5, arg6, arg7, arg8
- vld4.u8 {\arg0[\arg8],\arg1[\arg8],\arg2[\arg8],\arg3[\arg8]}, [r3], r1- vld4.u8 {\arg4[\arg8],\arg5[\arg8],\arg6[\arg8],\arg7[\arg8]}, [r0], r1-.endm
-
.macro STORE_LUMA_DATA_3 arg0, arg1, arg2, arg3, arg4, arg5, arg6
vst3.u8 {\arg0[\arg6],\arg1[\arg6],\arg2[\arg6]}, [r3], r1 vst3.u8 {\arg3[\arg6],\arg4[\arg6],\arg5[\arg6]}, [r0], r1@@ -503,31 +493,61 @@
vdup.u8 q4, r3
sub r3, r0, #4 // pix -= 4
- LOAD_LUMA_DATA_4 d16,d17,d18,d19,d24,d25,d26,d27,0
- LOAD_LUMA_DATA_4 d16,d17,d18,d19,d24,d25,d26,d27,1
- LOAD_LUMA_DATA_4 d16,d17,d18,d19,d24,d25,d26,d27,2
- LOAD_LUMA_DATA_4 d16,d17,d18,d19,d24,d25,d26,d27,3
- LOAD_LUMA_DATA_4 d16,d17,d18,d19,d24,d25,d26,d27,4
- LOAD_LUMA_DATA_4 d16,d17,d18,d19,d24,d25,d26,d27,5
- LOAD_LUMA_DATA_4 d16,d17,d18,d19,d24,d25,d26,d27,6
- LOAD_LUMA_DATA_4 d16,d17,d18,d19,d24,d25,d26,d27,7
- LOAD_LUMA_DATA_4 d20,d21,d22,d23,d28,d29,d30,d31,0
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- LOAD_LUMA_DATA_4 d20,d21,d22,d23,d28,d29,d30,d31,2
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- LOAD_LUMA_DATA_4 d20,d21,d22,d23,d28,d29,d30,d31,4
- LOAD_LUMA_DATA_4 d20,d21,d22,d23,d28,d29,d30,d31,5
- LOAD_LUMA_DATA_4 d20,d21,d22,d23,d28,d29,d30,d31,6
- LOAD_LUMA_DATA_4 d20,d21,d22,d23,d28,d29,d30,d31,7
+ vld1.u8 {d16}, [r3], r1+ vld1.u8 {d17}, [r3], r1+ vld1.u8 {d18}, [r3], r1+ vld1.u8 {d19}, [r3], r1+ vld1.u8 {d20}, [r3], r1+ vld1.u8 {d21}, [r3], r1+ vld1.u8 {d22}, [r3], r1+ vld1.u8 {d23}, [r3], r1+ vld1.u8 {d24}, [r3], r1+ vld1.u8 {d25}, [r3], r1+ vld1.u8 {d26}, [r3], r1+ vld1.u8 {d27}, [r3], r1+ vld1.u8 {d28}, [r3], r1+ vld1.u8 {d29}, [r3], r1+ vld1.u8 {d30}, [r3], r1+ vld1.u8 {d31}, [r3], r1- vswp q9, q10
- vswp d17,d18
- vswp d21,d22
- vswp q13,q14
- vswp d25,d26
- vswp d29,d30
- sub r0, r0, r1 , lsl #4
+ vtrn.u32 d16, d20
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+ vtrn.u32 d19, d23
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+
+ vtrn.u16 d16, d18
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+
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+
+ vswp d17, d24
+ vswp d19, d26
+ vswp d21, d28
+ vswp d23, d30
+
+ vswp q12, q9
+ vswp q14, q11
+
+ vswp q12, q10
+ vswp q13, q11
MASK_MATRIX q10, q11, q12, q13, q5, q4, q6